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11 月 24 日消息，在本月早些時候的 SC25 大會上，CXL 聯(lián)盟發(fā)布了 CXL 4.0 規(guī)范。這版規(guī)范基于 PCIe 7.0 構(gòu)建，數(shù)據(jù)速率達 128GT/s，吞吐量是上代 CXL 3.0 的 2 倍。
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除速率的提升外，CXL 4.0 還在系統(tǒng)架構(gòu)和拓撲方面提供了更高的靈活性，其支持原生 ×2 寬度、支持最多 4 個重定時器 (Retimer)、允許多個上游端口聚合捆綁為一個邏輯實體；此外其擁有更強的內(nèi)存可靠性和可維護性，能滿足下一代數(shù)據(jù)密集型應(yīng)用的需求。